PLL: Yes, მთავარი მიზანი: Intel CPU Servers, შეყვანა: Clock, გამომავალი: LVCMOS, სქემების რაოდენობა: 1, თანაფარდობა - შეყვანა: გამომავალი: 3:22,
PLL: Yes, მთავარი მიზანი: SONET/SDH, ATM applications, შეყვანა: Clock, გამომავალი: CML, სქემების რაოდენობა: 1, თანაფარდობა - შეყვანა: გამომავალი: 1:2,
